Paralelismo de hardware

 Una arquitectura DSP de Von Neumann estándar requiere 256 ciclos para completar un filtro FIR de 256 tomas, mientras que los FPGA de Xilinx pueden lograr el mismo resultado en un solo ciclo de reloj.


Este enorme paralelismo se traduce en niveles excepcionales de rendimiento DSP:

·         22 TeraMAC de rendimiento de punto fijo

·         7.3 TeraFLOP para coma flotante de precisión única

·         11 TeraFLOP para coma flotante de media precisión

Soluciones DSP integrales

Las soluciones Xilinx DSP incluyen silicio, IP, diseños de referencia, placas de desarrollo, herramientas, documentación y capacitación para habilitar una amplia gama de aplicaciones en una amplia gama de mercados, que incluyen, entre otros, comunicaciones inalámbricas, centro de datos y aeroespacial y defensa. .

Flujos de desarrollo integral

Hay varios flujos de herramientas disponibles para diferentes modelos de uso y diferentes niveles de abstracción del diseño:

Los diseñadores de hardware pueden diseñar en:

·         Diseño de nivel de sistema y RTL logrado con Vivado® Design Suite

·         C / C ++ con Vivado High Level Synthesis

·         Matlab® y Simulink® usando System Generator para DSP ™ .

Los desarrolladores de software acostumbrados a desarrollar en C / C ++ pueden diseñar usando:

·         Síntesis de alto nivel vivado

·         SDSoC para diseños basados ​​en SoC con Zynq®-7000 y Zynq® UltraScale + ™

·         SDAccel ™ para la aceleración del centro de datos

Los arquitectos de sistemas pueden evaluar rápidamente nuevos algoritmos con:

·         Generador de sistemas para DSP para modelado de sistemas en Matlab o Simulink

·         Síntesis de alto nivel de Vivado para exploración algorítmica en C o C ++


Referencia

DSP. (s. f.). Xilinx. https://www.xilinx.com/products/technology/dsp.html#overview



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